A54SX32-BG208I_集成电路资料查询网

54sx 家族 fpgas
22 v3.1
54sx 定时 model*
hard-连线的 时钟
外部 设置-向上 = t
INY
+ t
IRD1
+ t
SUD
– t
HCKH
= 1.5 + 0.3 + 0.5 – 1.0 = 1.3 ns
时钟-至-输出 (管脚-至-管脚)
=t
HCKH
+ t
RCO
+ t
RD1
+ t
DHL
= 1.0 + 0.8 + 0.3 + 1.6 = 3.7 ns
routed 时钟
外部 设置-向上 = t
INY
+ t
IRD1
+ t
SUD
– t
RCKH
= 1.5 + 0.3 + 0.5 – 1.5 = 0.8 ns
时钟-至-输出 (管脚-至-管脚)
=t
RCKH
+ t
RCO
+ t
RD1
+ t
DHL
= 1.52+ 0.8 + 0.3 + 1.6 = 4.2 ns
*values 显示 为 a54sx08-3, worst-情况 商业的 情况.
输出 延迟内部的 延迟输入 延迟
hard-连线的
i/o 单元
F
HMAX
= 320 mhz
t
INY
= 1.5 ns
t
IRD2
= 0.6 ns
Combinatorial
Cell
t
PD
=0.6 ns
寄存器
Cell
i/o 单元
t
RD1
= 0.3 ns
t
DHL
= 1.6 ns
i/o 单元
Routed
时钟
F
最大值
= 250 mhz
D
Q
D
Q
t
DHL
= 1.6 ns
t
ENZH
= 2.3 ns
t
RD1
= 0.3 ns
t
RCO
= 0.8 ns
t
SUD
= 0.5 ns
t
HD
= 0.0 ns
t
RD4
= 1.0 ns
t
RD8
= 1.9 ns
Predicted
Routing
延迟
t
RCKH
= 1.5 ns (100% 加载)
t
RD1
= 0.3 ns
寄存器
Cell
t
RCO
= 0.8 ns
时钟
t
HCKH
= 1.0 ns

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54sx 家族 fpgas 22 v3.1 54sx 定时 model* hard-连线的时钟外部设置-向上 = t INY + t IRD1 + t SUD – t HCKH = 1.5 + 0.3 + 0.5 – 1.0 = 1.3 ns 时钟-至-输出 (管脚-至-管脚) =t HCKH + t RCO + t RD1 + t DHL = 1.0 + 0.8 + 0.3 + 1.6 = 3.7 ns routed 时钟外部设置-向上 = t INY + t IRD1 + t SUD – t RCKH = 1.5 + 0.3 + 0.5 – 1.5 = 0.8 ns 时钟-至-输出 (管脚-至-管脚) =t RCKH + t RCO + t RD1 + t DHL = 1.52+ 0.8 + 0.3 + 1.6 = 4.2 ns *values 显示为 a54sx08-3, worst-情况商业的情况. 输出延迟内部的延迟输入延迟 hard-连线的 i/o 单元 F HMAX = 320 mhz t INY = 1.5 ns t IRD2 = 0.6 ns Combinatorial Cell t PD =0.6 ns 寄存器 Cell i/o 单元 t RD1 = 0.3 ns t DHL = 1.6 ns i/o 单元 Routed 时钟 F 最大值 = 250 mhz D Q D Q t DHL = 1.6 ns t ENZH = 2.3 ns t RD1 = 0.3 ns t RCO = 0.8 ns t SUD = 0.5 ns t HD = 0.0 ns t RD4 = 1.0 ns t RD8 = 1.9 ns Predicted Routing 延迟 t RCKH = 1.5 ns (100% 加载) t RD1 = 0.3 ns 寄存器 Cell t RCO = 0.8 ns 时钟 t HCKH = 1.0 ns

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