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资料编号:878339
 
资料名称:PIC16CE625T-20I/JW
 
文件大小: 2355K
   
说明
 
介绍:
OTP 8-Bit CMOS MCU with EEPROM Data Memory
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
PIC16CE62X
ds40182a-页 26
初步的
1998 微芯 技术 公司
5.2 portb 和 trisb 寄存器
PORtb 是 一个 8-位 宽 bi-directional 端口. 这
相应的 数据 方向 寄存器 是 trisb. 一个 '1' 在
trisb 寄存器 puts 这 相应的 输出 驱动器
在 一个 高 阻抗 模式. 一个 '0' 在 这 trisb 寄存器
puts 这 内容 的 这 输出 获得 在 这 选择
管脚(s).
Reading portb 寄存器 读 这 状态 的 这 管脚,
whereas writing 至 它 将 写 至 这 端口 获得. 所有 写
operations 是 读-modify-写 行动. 所以 一个 写
至 一个 端口 implies 那 这 端口 管脚 是 first 读, 然后
这个 值 是 modified 和 写 至 这 端口 数据 获得.
各自 的 这 portb 管脚 有 一个 弱 内部的 拉-向上
(
200
µ
一个 典型). 一个 单独的 控制 位 能 转变 在 所有 这
拉-ups. 这个 是 完毕 用 clearing 这 rbpu
(选项<7>) 位. 这 弱 拉-向上 是 automatically
turned 止 当 这 端口 管脚 是 configured 作 一个 输出.
这 拉-ups 是 无能 在 电源-在 重置.
F我们的 的 portb’s 管脚, rb7:rb4, 有 一个 中断 在
改变 特性. 仅有的 管脚 configured 作 输入 能
导致 这个 中断 至 出现 (i.e., 任何 rb7:rb4 管脚
configured 作 一个 输出 是 excluded 从 这 中断
在 改变 comparison). 这 输入 管脚 (的 rb7:rb4)
是 对照的 和 这 old 值 latched 在 这 last
读 的 portb. 这 “mismatch” 输出 的 rb7:rb4
是 或者’ed 一起 至 发生 这 rbif 中断 (flag
latched 在 intcon<0>).
图示 5-5: 块 图解 的
rb7:rb4 管脚
数据 获得
从 其它
RBPU
(2)
P
V
DD
i/o
QD
CK
QD
CK
Q D
EN
Q D
EN
数据 总线
wr portb
wr trisb
设置 rbif
tris 获得
rd trisb
rd portb
rb7:rb4 管脚
拉-向上
rd 端口
获得
TTL
输入
缓存区
管脚
(1)
便条 1: i/o 管脚 有 二极管 保护 至 v
DD
和 v
SS
.
便条 2: trisb = 1 使能 弱 拉-向上 如果 rbpu
= '0'
(选项<7>).
ST
缓存区
rb7:rb6 在 串行 程序编制 模式
这个 中断 能 wake 这 设备 从 睡眠. 这
用户, 在 这 中断 维护 routine, 能 clear 这
interrupt 在 这 下列的 manner:
一个) 一个y 读 或者 写 的 portb. 这个 将 终止 这
mismatch 情况.
b) clear flag 位 rbif.
一个 mismatch 情况 将 continue 至 设置 flag 位 rbif.
读 portb 将 终止 这 mismatch 情况, 和
准许 flag 位 rbif 至 是 cleared.
这个 中断 在 mismatch 特性, 一起 和
softw是 configurable 拉-ups 在 这些 四 管脚 准许
容易 接口 至 一个 关键 垫子 和 制造 它 可能 为
wake-向上 在 关键-depression. (看 an552 在 这
微芯
Embedded 控制 handbook
.)
这 中断 在 改变 特性 是 推荐 为
wake-向上 在 关键 depression 运作 和 行动
在哪里 portb 是 仅有的 使用 为 这 中断 在 改变
特性. Polling 的 portb 是 不 推荐 当
使用 这 中断 在 改变 特性.
图示 5-6: 块 图解 的
rb3:rb0 管脚
便条:
如果 一个 改变 在 这 i/o 管脚 应当 出现
当 这 读 运作 是 正在 executed
(星t 的 这 q2 循环), 然后 这 rbif inter-
rupt flag 将 不 得到 设置.
数据 获得
RBPU
(2)
P
V
DD
QD
CK
QD
CK
Q D
EN
数据 总线
wr portb
wr trisb
rd trisb
rd portb
拉-向上
rd 端口
rb0/int
i/o
管脚
(1)
TTL
输入
缓存区
便条 1: i/o 管脚 有 二极管 保护 至 v
DD
和 v
SS
.
便条 2: trisb = 1 使能 弱 拉-向上 如果 rbpu
= '0'
(选项<7>).
ST
缓存区
62x.bk 页 26 tuesday, march 10, 1998 3:40 pm
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