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十一月 9, 1998 (版本 3.1) 7-21
xc3000 序列 地方 可编程序的 门 arrays
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一个 同步的 开始-向上 sequence 和 变为 运算的.
看 图示 22. 二 cclk 循环 之后 这 completion 的
加载 配置 数据, 这 用户 i/o 管脚 是 使能 作
配置. 作 选择, 这 内部的 用户-逻辑 重置 是
released 也 一个 时钟 循环 在之前 或者 之后 这 i/o 管脚
变为 起作用的. 一个 类似的 定时 选择 是 可编程序的
为 这 完毕/prog
输出 信号. 完毕/prog将 也
是 编写程序 至 是 一个 打开 流 或者 包含 一个 拉-向上
电阻 至 accommodate 连线的 anding. 这 高 在
配置 (hdc) 和 低 在 配置 (ldc
)
是 二 用户 i/o 管脚 这个 是 驱动 起作用的 当 一个
fpga 是 在 它的 initialization, clear 或者 配置 states. 它们
和 完毕/prog
提供 信号 为 控制 的 外部
逻辑 信号 此类 作 重置, 总线 使能 或者 prom 使能
在 配置. 为 并行的 主控 配置
模式, 这些 信号 提供 prom 使能 控制 和
准许 这 数据 管脚 至 是 shared 和 用户 逻辑 信号.
用户 i/o 输入 能 是 编写程序 至 是 也 ttl 或者
cmos 兼容 门槛. 在 电源-向上, 所有 输入 有
ttl 门槛 和 能 改变 至 cmos 门槛 在 这
completion 的 配置 如果 这 用户 有 选择 cmos
门槛. 这 门槛 的 pwrdwn
和 这 直接 时钟
输入 是 fixed 在 一个 cmos 水平的.
如果 这 结晶 振荡器 是 使用, 它 将 begin 运作 在之前
配置 是 完全 至 准许 时间 为 stabilization
在之前 它 是 连接 至 这 内部的 电路系统.
配置 数据
配置 数据 至 定义 这 函数 和 interconnec-
tion 在里面 一个 地方 可编程序的 门 排列 是 承载 从
一个 外部 存储 在 电源-向上 和 之后 一个 re-程序 sig-
nal. 一些 方法 的 自动 和 控制 加载 的
这 必需的 数据 是 有. 逻辑 水平 应用 至
模式 选择 管脚 在 这 开始 的 配置 时间 deter-
mine 这 方法 至 是 使用. 看 表格 1. 这 数据 将 是
也 位-串行 或者 字节-并行的, 取决于 在 这 configu-
限定 模式. 这 不同的 fpgas 有 不同的 sizes 和
号码 的 数据 frames. 至 维持 兼容性 在
各种各样的 设备 类型, 这 xilinx 产品 families 使用 com-
patible 配置 formats. 为 这 xc3020a, configura-
tion 需要 14779 位 为 各自 设备, arranged 在 197
数据 frames. 一个 额外的 40 位 是 使用 在 这 标头.
看图示 22. 这 明确的 数据 format 为 各自 设备 是
生产 用 这 开发 系统 和 一个 或者 更多 的
这些 files 能 然后 是 联合的 和 appended 至 一个 长度
计数 preamble 和 是 transformed 在 一个 prom format
文件 用 这 开发 系统. 一个 兼容性 例外
precludes 这 使用 的 一个 xc2000-序列 设备 作 这 mas-
ter 为 xc3000-序列 设备 如果 它们的 完毕 或者 重置 是
编写程序 至 出现 之后 它们的 输出 变为 起作用的.
这 系 选项 定义 输出 水平 的 unused blocks 的 一个
设计 和 connects 这些 至 unused routing resources.
这个 阻止 indeterminate 水平 那 might 生产 par-
asitic 供应 电流. 如果 unused blocks 是 不 sufficient 至
完全 这 系, 这 用户 能 表明 nets 这个 必须 不
Preamble 长度 计数 数据
12 24 4
数据 框架
开始
位
开始
位
3
4
last 框架
Postamble
i/o 起作用的
完毕
内部的 重置
长度 count*
这 配置 数据 组成 的 一个 composite
40-位 preamble/长度 计数, followed 用 一个 或者
更多 concatenated fpga programs, separated 用
4-位 postambles. 一个 额外的 最终 postamble 位
是 增加 为 各自 从动装置 设备 和 这 结果 rounded
向上 至 一个 字节 boundary. 这 长度 计数 是 二 较少
比 这 号码 的 结果 位.
定时 的 这 assertion 的 完毕 和
末端 的 这 内部的 重置
将 各自 是 编写程序 至 出现
一个 循环 在之前 或者 之后 这 i/o 输出
变为 起作用的.
重的 线条 表明 这 default 情况
X5988
程序
弱 拉-向上
*
停止
3
停止
DIN
图示 22: 配置 和 开始-向上 的 一个 或者 更多 fpgas.
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