spartan 和 spartan-xl families 地方 可编程序的 门 arrays
ds060 (v1.6) 九月 19, 2001
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产品 规格
1-800-255-7778
R
配置
这 0010 preamble 代号 indicates 那 这 下列的 24 位
代表 这 长度 计数 为 串行 模式. 这 长度
计数 是 这 总的 号码 的 配置 clocks 需要 至
加载 这 完全 配置 数据. (四 额外的 con-
figuration clocks 是 必需的 至 完全 这 配置
处理, 作 discussed 在下.) 之后 这 preamble 和 这
长度 计数 有 被 passed 通过 至 任何 设备 在 这
daisy chain, 它的 dout 是 使保持 高 至 阻止 框架 开始
位 从 reaching 任何 daisy-chained 设备. 在 spar-
tan-xl 表示 模式, 这 长度 计数 位 是 ignored,
和 dout 是 使保持 低, 至 使不能运转 这 next 设备 在 这
pseudo daisy chain.
一个 明确的 配置 位, early 在 这 第一 框架 的 一个 mas-
ter 设备, 控制 这 配置-时钟 比率 和 能
增加 它 用 一个 因素 的 第八. 因此, 如果 一个 快 configura-
tion 时钟 是 选择 用 这 bitstream, 这 slower 时钟 比率
是 使用 直到 这个 配置 位 是 发现.
各自 框架 有 一个 开始 地方 followed 用 这 框架-configu-
限定 数据 位 和 一个 框架 错误 地方. 如果 一个 框架 数据 错误
是 发现, 这 fpga halts 加载, 和 信号 这 错误 用
拉 这 打开-流 init
管脚 低. 之后 所有 配置
frames 有 被 承载 在 一个 fpga 使用 一个 串行
模式, dout 又一次 跟随 这 输入 数据 所以 那 这
remaining 数据 是 passed 在 至 这 next 设备. 在
Spartan-xl 表示 模式, 当 这 第一 设备 是 全部地 pro-
grammed, dout 变得 高 至 使能 这 next 设备 在 这
chain.
delaying 配置 之后 电源-向上
那里 是 二 方法 的 delaying 配置 之后
电源-向上: 放 一个 逻辑 低 在 这 程序
输入, 或者 拉
这 双向的 init
管脚 低, 使用 一个 打开-集电级
(打开-流) 驱动器. (看图示 30.)
一个 低 在 这 程序
输入 是 这 更多 radical
approach, 和 是 推荐 当 这 电源-供应 上升
时间 是 过度的 或者 poorly 定义. 作 长 作 程序
是 低, 这 fpga keeps clearing 它的 配置 记忆.
当 程序
变得 高, 这 配置 记忆 是
cleared 一个 更多 时间, followed 用 这 beginning 的 config-
uration, 提供 这 init
输入 是 不 externally 使保持 低.
便条 那 一个 低 在 这 程序
输入 automatically
forces 一个 低 在 这 init
输出. 这 spartan/xl pro-
GRAM管脚 有 一个 永久的 弱 拉-向上. 避免 支持
程序
低 为 更多 比 500
µ
s.
使用 一个 打开-集电级 或者 打开-流 驱动器 至 支撑 init
低 在之前 这 beginning 的 配置 导致 这 fpga
至 wait 之后 完成 这 配置 记忆 clear
运作. 当 init
是 非 变长 使保持 低 externally, 这
设备 确定 它的 配置 模式 用 capturing 这
状态 的 这 模式 管脚, 和 是 准备好 至 开始 这 configura-
tion 处理. 一个 主控 设备 waits 向上 至 一个 额外的
300
µ
s 至 制造 确信 那 任何 slaves 在 这 optional daisy
chain 有 seen 那 init
是 高.
图示 30:
电源-向上 配置 sequence
INIT
高? 如果
主控
样本
模式 线条
加载 一个
配置
数据 框架
框架
错误
通过
配置
数据 至 dout
V
CC
有效的
非
Yes
Yes
非
非
Yes
运算的
开始-向上
Sequence
非
Yes
~1.3
µ
s 每 框架
主控 延迟 在之前
抽样 模式 线条
主控 cclk
变得 起作用的
F
拉 init 低
和 停止
ds060_30_080400
EXTEST*
样本/preload
绕过
CONFIGURE*
(* 如果 程序 = 高)
样本/preload
绕过
EXTEST
样本 preload
绕过
用户 1
用户 2
配置
READBACK
如果 boundary scan
是 选择
config-
uration
记忆
全部
CCLK
计数 相等
长度
计数
完全地 clear
配置 记忆
once 更多
ldc 输出 = l, hdc 输出 = h
boundary scan
说明
有:
i/o 起作用的
保持 clearing
配置
记忆
测试 模式, 发生
一个 时间-输出 脉冲波
的 16 或者 64 ms
程序
= 低
非
Yes
Yes
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