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资料编号:909650
 
资料名称:AD7840JN
 
文件大小: 337K
   
说明
 
介绍:
LC2MOS Complete 14-Bit DAC
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
AD7840
rev. b
–11–
ad7840–68000 接口
一个 接口 在 这 ad7840 和 这 68000 microproces-
sor 是 显示 在 图示 19. 在 这个 接口 例子, 这
LDAC
输入 是 hardwired 低. 作 一个 结果 这 dac 获得 和 相似物
输出 是 updated 在 这 rising 边缘 的
WR
. 一个 单独的 move
操作指南, 因此, 负载 这 输入 获得 和 updates 这 输出.
move.w d0,$dac
d0 = 68000 d0 寄存器
dac = ad7840 地址
图示 19. ad7840–mc68000 并行的 接口
串行 接合
计算数量 20 至 23 显示 这 ad7840 配置 为 串行 inter-
facing 和 这
CS
输入 hardwired 至 –5 v. 这 并行的 总线 是
不 使活动 在 串行 交流 和 这 ad7840.
ad7840–adsp-2101/adsp-2102 串行 接口
图示 20 显示 一个 串行 接口 在 这 ad7840 和 这
adsp-2101/adsp-2102 dsp 处理器. 也 包含 在 这
接口 是 这 ad7870, 一个 12-位 一个/d 转换器. 一个 接口
此类 作 这个 是 合适的 为 modem 和 其它 产品 这个
有 一个 dac 和 一个 模数转换器 在 串行 交流 和 一个
微处理器.
这 接口 使用 just 一个 的 这 二 串行 端口 的 这
adsp-2101/adsp-2102. 转换 是 initiated 在 这
ad7870 在 一个 fixed 样本 比率 (e.g., 9.6 khz) 这个 是 提供
用 一个 计时器 或者 时钟 恢复 电路系统. 当 交流
takes 放置 在 这 模数转换器 和 这 adsp-2101/ adsp-2102,
这 ad7870
SSTRB
线条 是 低. 这个
SSTRB
线条 是 使用 至
提供 一个 框架 同步 脉冲波 为 这 ad7840
同步
和 adsp-2101/adsp-2102 tfs 线条. 这个 意思 那 com-
munication 在 这 处理器 和 这 ad7840 能 仅有的
引领 放置 当 这 ad7870 是 communicating 和 这 处理器.
这个 arrangement 是 desirable 在 系统 此类 作 modems 在哪里
这 dac 和 模数转换器 交流 应当 是 同步的.
这 使用 的 这 ad7870 sclk 为 这 ad7840 sclk 和
adsp-2101/adsp-2102 sclk 意思 那 仅有的 一个 串行 端口
的 这 处理器 是 使用. 这 串行 时钟 为 这 ad7870 必须
是 设置 为 持续的 时钟 为 准确无误的 运作 的 这个 接口.
数据 从 这 adsp-2101/adsp-2102 是 有效的 在 这 下落
边缘 的 sclk. 这
LDAC
输入 的 这 ad7840 是 permanently
低 所以 这 更新 的 这 dac 获得 和 相似物 输出 takes
放置 在 这 sixteenth 下落 边缘 的 sclk (和
同步
低).
这 format 管脚 的 这 ad7840 必须 是 系 至 +5 v 和
这 justify 管脚 系 至 dgnd 为 这个 接口 至 运作
correctly.
图示 20. 完全 dac/模数转换器 串行 接口
ad7840–dsp56000 串行 接口
一个 串行 接口 在 这 ad7840 和 这 dsp56000 是
显示 在 图示 21. 这 dsp56000 是 配置 为 正常的
模式 同步的 运作 和 gated 时钟. 它 是 也 设置 向上
为 一个 16-位 文字 和 sck 和 sc2 作 输出 和 这 fsl
控制 位 设置 至 一个 0. sck 是 内部 发生 在 这
dsp56000 和 应用 至 这 ad7840 sclk 输入. 数据 从
这 dsp56000 是 有效的 在 这 下落 边缘 的 sck. 这 sc2
输出 提供 这 framing 脉冲波 为 有效的 数据. 这个 线条 必须
是 inverted 在之前 正在 应用 至 这
同步
输入 的 这
ad7840.
LDAC
输入 的 这 ad7840 是 连接 至 dgnd 所以 这
更新 的 这 dac 获得 takes 放置 在 这 sixteenth 下落
边缘 的 sclk. 作 和 这 previous 接口, 这 format
管脚 的 这 ad7840 必须 是 系 至 +5 v 和 这 justify 管脚
系 至 dgnd.
图示 21. ad7840–dsp56000 串行 接口
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