mc145151–2 通过 mc145158–2
MOTOROLA
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设计 仔细考虑
phase–locked 循环 — low–pass 过滤 设计
c)
_
+
一个
C
R
2
C
VCO
C
VCO
R
2
b)
一个)
C
VCO
PD
输出
PD
输出
φ
R
—
φ
V
—
PD
输出
—
φ
R
φ
V
R
1
R
1
R
1
R
1
R
2
便条: sometimes r
1
是 分割 在 二 序列 电阻器, 各自 r
1
÷
2. 一个 电容 c
C
是 然后 放置 从 这 中点 至 地面 至 更远
过滤
φ
V
和
φ
R
. 这 值 的 c
C
应当 是 此类 那 这 corner 频率 的 这个 网络 做 不 significantly affect
ω
n
.
这
φ
R
和
φ
V
输出 摆动 rail–to–rail. 因此, 这 用户 应当 是 细致的 不 至 超过 这 一般 模式 输入范围 的 这
运算放大 使用 在 这 combiner/循环 过滤.
定义:
n = total 分隔 比率 在 反馈 循环
K
φ
(阶段 探测器 增益) = v
DD
/
4
π
为 pd
输出
K
φ
(阶段 探测器 增益) = v
DD
/2
π
为
φ
V
和
φ
R
K
VCO
(vco 增益) =
2
π∆
f
VCO
∆
V
VCO
为 一个 典型 设计 w
n
(自然的 频率)
≈
2
π
fr
10
(在 阶段 探测器 输入).
damping 因素:
ζ ≅
1
推荐 读:
gardner, floyd m.,
phaselock 技巧 (第二 版本).
新 york, wiley–interscience, 1979.
manassewitsch, vadim,
频率 synthesizers: theory 和 设计 (第二 版本).
新 york, wiley–interscience, 1980.
blanchard, alain,
phase–locked 循环: 应用 至 coherent 接受者 设计.
新 york, wiley–interscience, 1976.
egan, william f.,
频率 综合 用 阶段 锁.
新 york, wiley–interscience, 1981.
rohde, ulrich l.,
数字的 pll 频率 synthesizers theory 和 设计.
englewood cliffs, nj, prentice–hall, 1983.
berlin, howard m.,
设计 的 phase–locked 循环 电路, 和 experiments.
indianapolis, howard w. sams 和 co., 1978.
kinley, harold,
这 pll synthesizer cookbook.
蓝 ridge summit, pa, tab 书, 1980.
an535, phase–locked 循环 设计 fundamentals, motorola 半导体 产品, inc., 1970.
ar254, phase–locked 循环 设计 articles, motorola 半导体 产品, inc., reprinted 和 许可 从
电子的 设计,
1987.
φ
R
—
φ
V
—
f(s) =
假设 增益 一个 是 非常 大, 然后:
f(s) =
ζ
=
ω
n
=
NR
1
C
R
1
sc + 1
ω
n
=
ζ
=
ω
n
R
2
C
2
R
2
sc + 1
R
1
sC
1
N
ω
n
2K
φ
K
VCO
f(s) =
ζ
=
ω
n
=
(r
1
+ R
2
)sc + 1
R
2
sC + 1
nc(r
1
+ r
2
)
R
2
C +
N
K
φ
K
VCO
K
φ
K
VCO
NCR
1
0.5
ω
n
Ǔ
ǒ
K
φ
K
VCO
K
φ
K
VCO
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