80C188EC13_集成电路资料查询网

80C186EC188EC 80L186EC188EC
表格 2 管脚 描述
(持续)
管脚 名字
管脚 输入 输出
管脚 描述
类型 类型 States
A18S5 IO 一个(l) h(z) 这些 管脚 驱动 地址 信息 在 这 地址
阶段 的 这 总线 cycle 在 T2 和 T3 这些 管脚 驱动
A17S4 r(wh)
状态 信息 (这个 是 总是 0 在 这 80c186ec)
A16S3 i(0)
这些 管脚 是 使用 作 输入 在 工厂 test 驱动
(a158) p(0)
这些 管脚 低 在 重置 将 导致 未说明的 operation
在 这 80C188EC A158 提供 有效的 地址 信息
为 这 全部 总线 cycle
AD15CAS2 IO s(l) h(z) 这些 管脚 是 部分 的 这 多路复用 地址 和 数据
bus 在 这 地址 阶段 的 这 总线 cycle 地址 位
AD14CAS1 r(z)
15 通过 13 是 提交 在 这些 管脚 和 能 是
AD13CAS0 i(0)
latched 使用 ALE 数据 信息 是 transferred 在 这
p(0)
数据 阶段 的 这 总线 cycle 管脚 AD1513CAS20 驱动 这
82C59 从动装置 地址 信息 在 中断
acknowledge cycles
AD120 IO s(l) h(z) 这些 管脚 提供 一个 多路复用 地址 和 数据 bus
在 这 地址 阶段 的 这 总线 cycle 地址 位 0
(ad70) r(z)
通过 12 (0 通过 7 在 这 80c188ec) 是 提交 在
i(0)
这 总线 和 能 是 latched 使用 ALE 数据 信息 是
p(0)
transferred 在 这 数据 阶段 的 这 总线 cycle
S20 O  h(z) 总线 循环 状态 是 encoded 在 这些 管脚 至 提供 总线
transaction information S20
是 encoded 作 follows
r(1)
i(1)
p(1)
S2
S1 S0 总线 循环 Initiated
0 0 0 中断 Acknowledge
0 0 1 读 IO
0 1 0 写 IO
0 1 1 处理器 HALT
1 0 0 操作指南 Queue Fetch
1 0 1 读 记忆
1 1 0 写 记忆
1 1 1 被动的 (非 总线 activity)
ALE O  h(0)
地址 获得 使能
输出 是 使用 至 strobe 地址
信息 在 一个 transparent 类型 获得 在 这 地址
r(0)
阶段 的 这 总线 cycle
i(0)
p(0)
BHE O  h(z)
字节 高 使能
输出 至 表明 那 这 总线 循环 在
progress 是 transferring 数据 在 这 upper half 的 这 数据
(rfsh
) r(z)
bus BHE 和 A0 有 这 下列的 logical encoding
i(1)
p(1)
A0 BHE
Encoding
(为 80C186EC
80L186EC 仅有的)
0 0 文字 转移
0 1 甚至 字节 转移
1 0 Odd 字节 转移
1 1 Refresh 运作
在 这 80C188EC80L188EC RFSH 是 asserted 低 至
表明 一个 refresh 总线 cycle
NOTE
管脚 names 在 parentheses 应用 至 这 80C188EC80L188EC
11

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80C186EC188EC 80L186EC188EC 表格 2 管脚描述 (持续) 管脚名字管脚输入输出管脚描述类型类型 States A18S5 IO 一个(l) h(z) 这些管脚驱动地址信息在这地址阶段的这总线 cycle 在 T2 和 T3 这些管脚驱动 A17S4 r(wh) 状态信息 (这个是总是 0 在这 80c186ec) A16S3 i(0) 这些管脚是使用作输入在工厂 test 驱动 (a158) p(0) 这些管脚低在重置将导致未说明的 operation 在这 80C188EC A158 提供有效的地址信息为这全部总线 cycle AD15CAS2 IO s(l) h(z) 这些管脚是部分的这多路复用地址和数据 bus 在这地址阶段的这总线 cycle 地址位 AD14CAS1 r(z) 15 通过 13 是提交在这些管脚和能是 AD13CAS0 i(0) latched 使用 ALE 数据信息是 transferred 在这 p(0) 数据阶段的这总线 cycle 管脚 AD1513CAS20 驱动这 82C59 从动装置地址信息在中断 acknowledge cycles AD120 IO s(l) h(z) 这些管脚提供一个多路复用地址和数据 bus 在这地址阶段的这总线 cycle 地址位 0 (ad70) r(z) 通过 12 (0 通过 7 在这 80c188ec) 是提交在 i(0) 这总线和能是 latched 使用 ALE 数据信息是 p(0) transferred 在这数据阶段的这总线 cycle S20 O  h(z) 总线循环状态是 encoded 在这些管脚至提供总线 transaction information S20 是 encoded 作 follows r(1) i(1) p(1) S2 S1 S0 总线循环 Initiated 0 0 0 中断 Acknowledge 0 0 1 读 IO 0 1 0 写 IO 0 1 1 处理器 HALT 1 0 0 操作指南 Queue Fetch 1 0 1 读记忆 1 1 0 写记忆 1 1 1 被动的 (非总线 activity) ALE O  h(0) 地址获得使能输出是使用至 strobe 地址信息在一个 transparent 类型获得在这地址 r(0) 阶段的这总线 cycle i(0) p(0) BHE O  h(z) 字节高使能输出至表明那这总线循环在 progress 是 transferring 数据在这 upper half 的这数据 (rfsh ) r(z) bus BHE 和 A0 有这下列的 logical encoding i(1) p(1) A0 BHE Encoding (为 80C186EC 80L186EC 仅有的) 0 0 文字转移 0 1 甚至字节转移 1 0 Odd 字节转移 1 1 Refresh 运作在这 80C188EC80L188EC RFSH 是 asserted 低至表明一个 refresh 总线 cycle NOTE 管脚 names 在 parentheses 应用至这 80C188EC80L188EC 11

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