80C188EC13_集成电路资料查询网

80C186EC188EC 80L186EC188EC
表格 2 管脚 描述
(持续)
管脚 名字
管脚 输入 输出
管脚 描述
类型 类型 States
P31TXI1 O  h(x)h(q)
Transmit 中断
输出 变得 起作用的 至 表明 那
串行 频道 1 有 完成 一个 transfer TXI1 是
r(0)
多路复用 和 一个 输出 仅有的 端口 function
i(q)
p(x)
P30RXI1 O  h(x)h(q)
Receive 中断
输出 变得 起作用的 至 表明 那
串行 频道 1 有 完成 一个 reception RXI1 是
r(0)
多路复用 和 一个 输出 仅有的 端口 function
i(q)
p(x)
WDTOUT O  h(q)
看门狗 计时器 输出
是 驱动 低 为 四 时钟
循环 当 这 看门狗 计时器 reaches zero WDTOUT
r(1)
将 是 ANDed 和 这 电源-在 重置 信号 至 重置 这
i(q)
处理器 当 这 看门狗 计时器 是 不 合适的 reset
p(x)
P27CTS1 IO 一个(l) h(x)
clear-至-send
输入 是 使用 至 阻止 这 传递
的 串行 数据 在 这 TXD 信号 pin CTS1
和 CTS0 是
P23CTS0
r(z)
多路复用 和 一个 IO 端口 function
i(x)
p(x)
P26BCLK1 IO 一个(l) h(x)
波特 时钟
输入 能 是 使用 作 一个 alternate 时钟
源 为 各自 的 这 整体的 串行 channels 这
P22BCLK0 一个(e) r(z)
BCLK 输入 是 多路复用 和 IO 端口 functions 这
i(x)
BCLK 输入 频率 不能 超过

这 运行
p(x)
频率 的 这 处理器 
P25TXD1 IO 一个(l) h(q)
Transmit 数据
输出 提供 串行 数据 information
这 TXD 输出 是 多路复用 和 IO 端口 functions
P21TXD0 r(z)
在 同步的 串行 communications TXD 将
i(x)i(q)
函数 作 一个 时钟 output
p(x)
P24RXD1 IO 一个(l) h(x)h(q)
Receive 数据
输入 accepts 串行 数据 information 这
RXD 管脚 是 多路复用 和 IO 端口 functions 在
P20RXD0 r(z)
同步的 串行 communications RXD 是 bi-directional
i(x)i(q)
和 将 变为 一个 输出 为 传递 的 数据 (txd
p(x)
变为 这 时钟)
DRQ30 I 一个(l) 
DMA 要求
输入 管脚 是 使用 至 要求 一个 DMA
transfer 这 定时 的 这 要求 是 依赖 在 这
编写程序 同步 mode
NOTES
1 准备好 是 一个(e) 为 这 rising 边缘 的 CLKOUT s(e) 为 这 下落 边缘 的 CLKOUT
2 管脚 names 在 parentheses 应用 至 这 80C188EC80L188EC
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80C186EC188EC 80L186EC188EC 表格 2 管脚描述 (持续) 管脚名字管脚输入输出管脚描述类型类型 States P31TXI1 O  h(x)h(q) Transmit 中断输出变得起作用的至表明那串行频道 1 有完成一个 transfer TXI1 是 r(0) 多路复用和一个输出仅有的端口 function i(q) p(x) P30RXI1 O  h(x)h(q) Receive 中断输出变得起作用的至表明那串行频道 1 有完成一个 reception RXI1 是 r(0) 多路复用和一个输出仅有的端口 function i(q) p(x) WDTOUT O  h(q) 看门狗计时器输出是驱动低为四时钟循环当这看门狗计时器 reaches zero WDTOUT r(1) 将是 ANDed 和这电源-在重置信号至重置这 i(q) 处理器当这看门狗计时器是不合适的 reset p(x) P27CTS1 IO 一个(l) h(x) clear-至-send 输入是使用至阻止这传递的串行数据在这 TXD 信号 pin CTS1 和 CTS0 是 P23CTS0 r(z) 多路复用和一个 IO 端口 function i(x) p(x) P26BCLK1 IO 一个(l) h(x) 波特时钟输入能是使用作一个 alternate 时钟源为各自的这整体的串行 channels 这 P22BCLK0 一个(e) r(z) BCLK 输入是多路复用和 IO 端口 functions 这 i(x) BCLK 输入频率不能超过  这运行 p(x) 频率的这处理器  P25TXD1 IO 一个(l) h(q) Transmit 数据输出提供串行数据 information 这 TXD 输出是多路复用和 IO 端口 functions P21TXD0 r(z) 在同步的串行 communications TXD 将 i(x)i(q) 函数作一个时钟 output p(x) P24RXD1 IO 一个(l) h(x)h(q) Receive 数据输入 accepts 串行数据 information 这 RXD 管脚是多路复用和 IO 端口 functions 在 P20RXD0 r(z) 同步的串行 communications RXD 是 bi-directional i(x)i(q) 和将变为一个输出为传递的数据 (txd p(x) 变为这时钟) DRQ30 I 一个(l)  DMA 要求输入管脚是使用至要求一个 DMA transfer 这定时的这要求是依赖在这编写程序同步 mode NOTES 1 准备好是一个(e) 为这 rising 边缘的 CLKOUT s(e) 为这下落边缘的 CLKOUT 2 管脚 names 在 parentheses 应用至这 80C188EC80L188EC 14

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