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资料编号:964810
 
资料名称:AD5532HSABC
 
文件大小: 182K
   
说明
 
介绍:
32-Channel 14-Bit DAC with High-Speed 3-Wire Serial Interface
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. 0
–3–
AD5532HS
(v
DD
= +4.75 v 至 +12 v, v
SS
= –4.75 v 至 –12 v; av
CC
= 4.75 v 至 5.25 v; dv
CC
= 2.7 v 至 5.25 v; agnd =
dgnd = dac_地 = 0 v; ref_在 = 2.5 v; 所有 输出 unloaded. 所有 规格 t
最小值
至 t
最大值
除非 否则 指出.)
参数
1,
2
一个 版本
3
单位 情况/comments
输出 电压 安排好 时间
4
10
µ
s 最大值 100 pf, 5 k
加载; 全部-规模 改变
回转 比率 0.85 v/
µ
s 典型值
数字的-至-相似物 glitch impulse 1 nv-s 典型值 1 lsb 改变 周围 主要的 carry
数字的 串扰 5 nv-s 典型值
相似物 串扰 1 nv-s 典型值
数字的 feedthrough 0.2 nv-s 典型值
输出 噪音 谱的 密度 @ 1 khz 170 nv/
Hz
典型值
注释
1
看 terminology
2
有保证的 用 设计 和 描绘, 不 生产 测试
3
b 版本: 工业的 温度 范围 –40
°
c 至 +85
°
c.
4
安排时间 从 这 终止 的 一个 写 sequence.
规格 主题 至 改变 没有 注意.
定时 特性
限制 在 t
最小值
, t
最大值
参数
1,
2,
3
(一个 版本) 单位 情况/comments
f
更新
1.1 mhz 最大值 频道 更新 比率
f
CLKIN
30 mhz 最大值 sclk 频率
t
1
13 ns 最小值 sclk 高 pulsewidth
t
2
13 ns 最小值 sclk 低 pulsewidth
t
3
15 ns 最小值
同步
下落 边缘 至 sclk 下落 边缘 建制 时间
t
4
50 ns 最小值
同步
低 时间
t
5
10 ns 最小值
同步
高 时间
t
6
10 ns 最小值 D
建制 时间
t
7
5 ns 最小值 D
支撑 时间
t
8
280 ns 最小值 19th sclk 下落 边缘 至
同步
下落 边缘 为 next 写
t
9
20 ns 最小值
重置
Pulsewidth
注释
1
看 定时 图解 在 图示 1.
2
有保证的 用 设计 和 描绘, 不 生产 测试.
3
所有 输入 信号 是 指定 和 t
R
= t
F
= 5 ns (10% 至 90% 的 dv
CC
) 和 安排时间 从 一个 电压 水平的 的 (v
IL
+ v
IH
)/2.
规格 主题 至 改变 没有 注意.
交流 特性
(v
DD
= +4.75 v 至 +12 v, v
SS
= –4.75 v 至 –12 v; av
CC
= 4.75 v 至 5.25 v; dv
CC
= 2.7 v 至 5.25 v;
agnd = dgnd = dac_地 = 0 v; 所有 规格 t
最小值
至 t
最大值
除非 否则 指出.)
1
2345
t
1
t
2
t
3
t
4
LSB
t
6
t
7
16 17 18 19
MSB
SCLK
同步
D
t
8
1
t
9
重置
t
5
图示 1. 串行 接口 定时 图解
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