AD6600ST/PCB_集成电路资料查询网

rev. 0
AD6600
–14–
ENCODE
CLK2

d [10:0]
rssi [2:0]
ab_输出
t
CLK2

H1
t
CLK2

H2
t
CLK2

L
t
CF2
t
CLK2

L
t
CF1
CLK2

2 CLK2

1 CLK2

2 CLK2

1 CLK2

2
t
ENCH
t
ENCL
t
ENC
t
CLK2

1
t
CLK2

2
t
CR2
t
CR1
t
s_den
t
h_den
t
s_den
t
h_den
t
h_aen
t
s_aen
t
h_aen
t
s_aen
ENCODE ENCODE ENCODE
图示 11. encode 建制-和-支撑 时间 特性
CLK2

d [10:0]
rssi [2:0]
ab_输出
3 2.6
8 8.4
6.2
6
图示 12. 典型 输出 上升 和 下降 时间
ENCODE
CLK2

20 30 50
20301818
8 8
40%
图示 13. encode = 20 msps, 职责 循环 = 40%
ENCODE
CLK2

2030 50
20 30
8 8
60%
2323
图示 14. encode = 20 msps, 职责 循环 = 60%

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rev. 0 AD6600 –14– ENCODE CLK2  d [10:0] rssi [2:0] ab_输出 t CLK2  H1 t CLK2  H2 t CLK2  L t CF2 t CLK2  L t CF1 CLK2  2 CLK2  1 CLK2  2 CLK2  1 CLK2  2 t ENCH t ENCL t ENC t CLK2  1 t CLK2  2 t CR2 t CR1 t s_den t h_den t s_den t h_den t h_aen t s_aen t h_aen t s_aen ENCODE ENCODE ENCODE 图示 11. encode 建制-和-支撑时间特性 CLK2  d [10:0] rssi [2:0] ab_输出 3 2.6 8 8.4 6.2 6 图示 12. 典型输出上升和下降时间 ENCODE CLK2  20 30 50 20301818 8 8 40% 图示 13. encode = 20 msps, 职责循环 = 40% ENCODE CLK2  2030 50 20 30 8 8 60% 2323 图示 14. encode = 20 msps, 职责循环 = 60%

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