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usb cy7c63722/23
CY7C63743
文档 #: 38-08022 rev. ** 页 50 的 58
26.0 切换 特性
参数 描述 最小值 最大值 单位 情况
内部的 时钟 模式
F
ICLK
内部的 时钟 频率 5.7 6.3 MHz 内部的 时钟 模式 使能
F
ICLK2
内部的 时钟 频率, usb
模式
5.91 6.09 MHz 内部的 时钟 模式 使能, 位 2 的 寄存器
0xf8h 是 设置 (精确 usb clocking)
[12]
外部 振荡器 模式
T
CYC
输入 时钟 循环 时间 164.2 169.2 ns usb 运作, 和 外部 ±1.5%
陶瓷的 共振器 或者 结晶
T
CH
时钟 高 时间 0.45 t
CYC
ns
T
CL
时钟 低 时间 0.45 t
CYC
ns
重置 定时
t
开始
时间-输出 延迟 之后 lvr/bor 24 60 ms
t
WAKE
内部的 wake-向上 时期 1 5 ms 使能 wake-向上 中断
[13]
t
WATCH
看门狗 计时器 时期 10.1 14.6 ms F
OSC
= 6 mhz
usb 驱动器 特性
T
R
转变 上升 时间 75 ns cload = 200 pf (10% 至 90%
[4]
)
T
R
转变 上升 时间 300 ns cload = 600 pf (10% 至 90%
[4]
)
T
F
转变 下降 时间 75 ns cload = 200 pf (10% 至 90%
[4]
)
T
F
转变 下降 时间 300 ns cload = 600 pf (10% 至 90%
[4]
)
T
RFM
上升/下降 时间 相一致 80 125 % t
r
/t
f
[4, 14]
V
CRS
输出 信号 转型
电压
[18]
1.3 2.0 V cload = 200 至 600 pf
[4]
usb 数据 定时
T
DRATE
低 速 数据 比率 1.4775 1.5225 mb/s ave. 位 比率 (1.5 mb/s ±1.5%)
T
DJR1
接受者 数据 jitter 容忍 –75 75 ns 至 next 转变
[15]
T
DJR2
接受者 数据 jitter 容忍 –45 45 ns 为 paired transitions
[15]
T
DEOP
差别的 至 eop 转变 skew –40 100 ns 便条 15
T
EOPR2
eop 宽度 在 接受者 670 ns accepts 作 eop
[15]
T
EOPT
源 eop 宽度 1.25 1.50
µ
s
T
UDJ1
差别的 驱动器 jitter –95 95 ns 至 next 转变,
图示 26-5
T
UDJ2
差别的 驱动器 jitter –150 150 ns 至 paired 转变,
图示 26-5
T
LST
宽度 的 se0 在 diff. 转变 210 ns
非-usb 模式 驱动器
特性
便条 16
T
FPS2
sdata/sck 转变 下降 时间 50 300 ns cload = 150 pf 至 600 pf
spi 定时
看
计算数量 26-6 至 26-9
[17]
T
SMCK
spi 主控 时钟 比率 2 MHz F
CLK
/3; 看
图示 17-1
T
SSCK
spi 从动装置 时钟 比率 2.2 MHz
注释:
12. initially f
ICLK2
= f
ICLK
直到 一个 usb 小包装板盒 是 received.
13. wake-向上 时间 为 wake-向上 调整 位 cleared 至 000b (最小 设置)
14. 测试 在 200 pf.
15. 量过的 在 交叉-在 要点 的 差别的 数据 信号.
16. 非-usb 模式 谈及 至 驱动 这 d–/sdata 和/或者 d+/sclk 管脚 和 这 控制 位 的 这 usb 状态 和 控制 寄存器, 和 控制 位 2 高.
17. spi 定时 指定 为 电容的 加载 的 50 pf, 和 gpio 输出 模式 = 01 (中等 低 驱动, 强 高 驱动).
18. 每 这 usb 2.0 规格, 表格 7.7, 便条 10, 这 第一 转变 从 这 空闲 状态 是 excluded.
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