DS1481
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详细地 管脚 描述
管脚 类型 描述
Vcc 直流 供应 电压.
ENI I 碎片 使能, 驱动 低 至 begin 1–wire i/o.
o1/bsy1 O 驱动 低 在 时间 slot (至 表明 一个 ds1481 busy 情况). 设置 至 状态
的 i1 之后 时间 slot 有 finished. o1/bsy1将 go 低 之后 d/clk变得 低 如果
样本 的 i/o 交流 是 低. returns 至 状态 的 i1 当 eni
变得
后面的 高 (看 图示 1).
o2/bsy2 O 驱动 低 在 时间 slot (至 表明 一个 ds1481 busy 情况). 设置 至 状态
的 i2 之后 时间 slot 有 finished. o2/bsy2
将 go 低 之后 d/clk变得 低 如果
样本 的 i/o 交流 是 低. returns 至 状态 的 i2 当 eni
变得
后面的 高 (看 图示 1).
d/clk I 数据/时钟 管脚. 使用 至 具体说明 类型 的 时间 slot 在之前 交流 begins.
之后 这 时间 slot 有 被 完成 这个 管脚 是 驱动 低 在 顺序 至 solicit
这 结果 的 这 时间 slot.
RES I 设置 低 (在之前 eni是 驱动 低) 至 具体说明 那 一个 重置 脉冲波 应当 是 gener-
ated 在 这 i/o 管脚.
地 系统 地面.
I1 I 能 是 连接 至 这 o1/bsy1 的 另一 ds1481. 将 也 是 连接
至 并行的 端口 printer’s busy 信号. 内部 牵引的 高 通过 一个 弱 电阻.
I2 I 能 是 连接 至 这 o2/bsy2的 另一 ds1481. 能 也 是 连接
至 一个 并行的 端口 printer 选择 输出 信号. 内部 牵引的 高 通过 一个 弱
电阻.
ENO O 设置 至 eni如果 不 这 last 部分 在 端口. 打开 流 输出 和 弱 内部的
pull–up 电阻.
i/o i/o 1–wire i/o 线条. bi–directional 线条 和 打开 流 输出.
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