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资料编号:991157
 
资料名称:IDT70V27S15PF
 
文件大小: 192K
   
说明
 
介绍:
HIGH-SPEED 3.3V 32K x 16 DUAL-PORT STATIC RAM
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
商业的 和 工业的 温度 范围
idt 70v27s/l
高-速 3.3v 32k x 16 双-端口 静态的 内存
18

BUSY


注释:
1. 管脚
BUSY
L
BUSY
R
是 两个都 输出 当 这 部分 是 配置 作 一个 主控. 两个都 是 输入 当 配置 作 一个 从动装置.
BUSY
输出 在 这 idt70v27 是
推-拉, 不 打开 流 输出. 在 slaves 这
BUSY
输入 内部 inhibits 写.
2. "l" 如果 这 输入 至 这 opposite 端口 是 稳固的 较早的 至 这 地址 和 使能 输入 的 这个 端口. "h" 如果 这 输入 至 这 opposite 端口 became 稳固的 之后 这 地址
和 使能 输入 的 这个 端口. 如果 t
APS
是 不 符合, 也
BUSY
L
或者
BUSY
R
= 低 将 结果.
BUSY
L
BUSY
R
输出 能 不 是 低 同时发生地.
3. 写 至 这 left 端口 是 内部 ignored 当
BUSY
L
输出 是 驱动 低 regardless 的 真实的 逻辑 水平的 在 这 管脚. 写 至 这 正确的 端口 是 内部 ignored
BUSY
R
输出 是 驱动 低 regardless 的 真实的 逻辑 水平的 在 这 管脚.
4. 谈及 至 碎片 使能 真实 表格.


注释:
1. 这个 表格 denotes 一个 sequence 的 events 为 仅有的 一个 的 这 第八 semaphores 在 这 idt70v27.
2. 那里 是 第八 semaphore flags 写 至 通过 i/o
0
和 读 从 所有 这 i/o's (i/o
0
-i/o
15
). 这些 第八 semaphores 是 addressed 用 一个
0
- 一个
2
.

这 idt70v27 提供 二 端口 和 独立的 控制, 地址 和
i/o 管脚 那 准许 独立 进入 为 读 或者 写 至 任何 location
在 记忆. 这 idt70v27 有 一个 自动 电源 向下 特性
控制 用
CE
0
和 ce
1
. 这
CE
0
CE
1
控制 这 在-碎片 电源
向下 电路系统 那 准许 这 各自的 端口 至 go 在 一个 备用物品 模式
当 不 选择 (
CE
高). 当 一个 端口 是 使能, 进入 至 这 全部
记忆 排列 是 permitted.

如果 这 用户 chooses 这 中断 函数, 一个 记忆 location (邮递 盒
或者 message 中心) 是 assigned 至 各自 端口. 这 left 端口 中断 标记
(
INT
L
) 是 asserted 当 这 正确的 端口 写 至 记忆 location 7ffe
(十六进制), 在哪里 一个 写 是 定义 作
CE
R
= r/
W
R
= v
IL
每 这 真实 表格
iv. 这 left 端口 clears 这 中断 通过 进入 的 地址 location
7ffe 当
CE
L
=
OE
L
= v
IL
, r/
W
是 一个 "don't 小心". likewise, 这 正确的
端口 中断 标记 (
INT
R
) 是 asserted 当 这 left 端口 写 至 记忆
location 7fff (十六进制) 和 至 clear 这 中断 标记 (
INT
R
), 这
正确的 端口 必须 读 这 记忆 location 7fff. 这 message (16 位) 在
7ffe 或者 7fff 是 用户-定义 自从 它 是 一个 addressable sram location.
如果 这 中断 func-tion 是 不 使用, 地址 locations 7ffe 和 7fff 是
不 使用 作 邮递 boxes, 但是 作 部分 的 这 随机的 进入 记忆. 谈及
至 真实 表格 iv 为 这 中断 运作.

busy 逻辑 提供 一个 硬件 indication 那 两个都 端口 的 这 内存
有 accessed 这 一样 location 在 这 一样 时间. 它 也 准许 一个 的 这
二 accesses 至 proceed 和 信号 这 其它 一侧 那 这 内存 是
Busy
.
BUSY
管脚 能 然后 是 使用 至 stall 这 进入 直到 这 运作 在
输入 输出
函数
CE
L
CE
R
一个
0L
-一个
14L
一个
0R
-一个
14R
BUSY
L
(1)
BUSY
R
(1)
X X 非 相一致 H H rmal
H X 相一致 H H rmal
X H 相一致 H H rmal
L L 相一致 (2) (2) Inhib
(3)
3603 tbl 17
功能 d0 - d15 left D
0
- d
15
正确的 状态
非 action 1 1 semaphore 自由
Left port 写s"0"Se编排hore 0 1 Left port 有se编排horeken
Right port 写s "0" 至Se编排hore 0 1 非 change.Right 一侧交流cess 至se编排hore
left 端口 写 "1" 至 semaphore 1 0 正确的 端口 obtains semaphore token
Left port 写s"0"Se编排hore 1 0 change.Left port 有交流cessse编排hore
正确的 端口 写 "1" 至 semaphore 0 1 left 端口 obtains semaphore token
left 端口 写 "1" 至 semaphore 1 1 semaphore 自由
正确的 端口 写 "0" 至 semaphore 1 0 正确的 端口 有 semaphore token
正确的 端口 写 "1" 至 semaphore 1 1 semaphore 自由
Left port 写s"0"Se编排hore 0 1 Left port 有se编排horeken
left 端口 写 "1" 至 semaphore 1 1 semaphore 自由
3603 tbl18
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