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资料编号:993204
 
资料名称:IDT72V275L15PF
 
文件大小: 213K
   
说明
 
介绍:
3.3 VOLT CMOS SuperSync FIFO
 
 


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18
商业的 和 工业的 温度 范围
idt72v275/72v285
图示 10. 读 定时 (第一 文字 下降 通过 模式
)
注释:
1. t
SKEW1
是 这 最小 时间 在 一个 rising rclk 边缘 和 一个 rising wclk 边缘 至 保证 那
IR
将 go 低 之后 一个 wclk 循环 加 t
WFF
. 如果 这 时间 在 这 rising 边缘 的 rclk 和 这 rising 边缘 的 wclk
是 较少 比 t
SKEW1
, 然后 这
IR
assertion 将 是 delayed 一个 extra wclk 循环.
2. t
SKEW2
是 这 最小 时间 在 一个 rising rclk 边缘 和 一个 rising wclk 边缘 至 保证 那
PAF
将 go 高 之后 一个 wclk 循环 加 t
PAF
. 如果 这 时间 在 这 rising 边缘 的 rclk 和 这 rising 边缘 的 wclk
是 较少 比 t
SKEW2
, 然后 这
PAF
deassertion 将 是 delayed 一个 extra wclk 循环.
3.
LD
= 高
4. n =
PAE
补偿, m =
PAF
补偿 和 d = 最大 先进先出 depth.
5. d = 32,769 为 idt72v275 和 65,537 为 idt72v285.
WCLK
12
WEN
D
0
- d
17
RCLK
t
ENS
REN
Q
0
- q
17
PAF
HF
PAE
IR
或者
W
1
W
1
W
2
W
3
W
m+2
W
[m+3]
t
OHZ
t
SKEW1
t
ENH
t
DS
t
DH
t
OE
t
一个
t
一个
t
一个
t
PAF
t
WFF
t
WFF
t
ENS
OE
t
SKEW2
W
D
4512 drw 13
t
PAE
W
[d-n]
W
[d-n-1]
t
一个
t
一个
t
HF
t
REF
W
[d-1]
W
D
t
一个
W
[d-n+1]
W
[m+4]
W
[d-n+2]
(1)
(2)
t
ENS
d-1
][
W
d-1
][
W
1
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